CN1152965A - 用于pci总线的磁盘驱动联接器接口 - Google Patents
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Abstract
一种用于PCI适配扩展槽中的IDE兼容的添加卡。以未加使用过的PCI管脚来提供来自IDE添加卡的所需中断信号的适当路由。在PCI槽中的IDE卡的存在使信令电路为IDE中断提供路由将其加到计算机系统的中断控制器上,并重新将存在的硬盘中断信号给中断控制器作为辅助硬盘中断。另一未用的管脚用来提供点亮计算机系统硬盘有效指示LED的信号。提供一门电路,这样,非IDE、PCI适配的添加卡则可在PCI槽中不受影响地工作。
Description
发明背景发明领域
本发明涉及计算机系统外设联接。具体讲,本发明涉及以应急PCI局域总线标准互联外设。技术背景
在计算机工业中,一个广泛接受的系统体系为AT系统设计。支持此类型系统的计算系统母板通常包括用于在各系统部件之间提供系统间通信的标准化的输入/输出(I/O)总线。例如,系统的中央处理器(CPU)将采用此总线,用于从系统的硬盘驱动器或其它存储设备上读取数据或向其写数据。这种系统总线标准包括已知的ISA和EISA标准,它可经综合驱动电子设备(IDE)接口联至硬盘驱动器上。
由于计算机处理器的工艺已有所发展,传统ISA、EISA和其它I/O总线标准已被证实不适用于带有高级处理器的计算机系统。近来引入了一种新的I/O总线标准用作主要I/O总线,它可提供比已经存在的总线标准更宽的带宽。外设互联(PCI)总线已被计算机产业迅速广泛地接受。PCI总线标准提供高的带宽和灵活性,它不同于新的处理器技术并且增加了处理器速度。此刻,计算机系统体系主要是为速度敏感的外设而设计的,例如将要采用PCI总线的图形加速器和SCSI磁盘驱动控制器。
当今设计的采用PCI总线的计算系统大体包括诸如上面所描述的用于与多个现有的先前设计的外设兼容器的慢辅助I/O总线。在PCI总线标准与先前的I/O总线标准之间,特别是各种中断规约方面有许多不同。例如,EISA/ISA总线体提供16个中断信号,IRQ[0:15]的每一个都用于不同的应用。PCI总线还提供4种共享的中断,INTR[A:D],每一个都被PCI总线的所有槽所共享。
今日的计算机系统中所用的许多硬盘驱动器采用综合驱动电子设备(IDE)标准接口。IDE接口已被证实物有所值并在PC母板的产业中被广泛接受。IDE的规范已更改并可以在较快的“局域总线”类的IDE驱动器上提供较快的驱动能力。但是,将简单IDE驱动器接到PCI总线上是相当困难且价昂的。由于在IDE驱动器与软盘驱动器接口间共享计算机系统寄存器的长期的PCAT兼容要求的存在,使复杂性提高了。寄存器的共享在访问寄存器期间需使两个装置驱动数据总线。具体讲,地址3f7h的I/O读出为IDE装置驱动位[0:6]和软盘装置驱动位[7]。通过使用双向三稳态缓存器当两个装置挂在同一ISA或EISA总线时易于实现。由于必须用来代替普通软盘驱动DMA传送的特定“总线主体”装置,使满足支持PCI总线的软盘驱动器乃致IDE接口的需求是一种不划算的解决方案。总之,由于软盘驱动器太慢而使PCI的实施在系统PCI的工作特性上引入瓶颈,因此效果较差。
在PCI总线上实施IDE兼容硬盘驱动的另一问题是,PCI总线并不提供某种所需的信号去支持IDE接口。这些信号包括分配的硬盘中断输出以及启动计算机系统的硬盘驱动器工作LED指示器的输出。此外,PCI规范规定没有多余的管脚可被不适用的装置所利用。本发明的优点及目的在于提供一种在计算机系统母板上的完全适用的PCI槽,并还可提供一种用在PCI总线上的对IDE磁盘驱动器的接口。发明概述
从上文可知,计算机系统的特性可以通过提供一种机构使带IDE接口的磁盘驱动器可用于计算机系统的增强的I/O总线上而得以加强。因此,本发明的目的在于提供一种方法和装置通过新的互联装置而联到诸如PCI总线的高速局域总线而在计算机系统中采用IDE接口的硬盘驱动器。本发明的其它目的在于提供计算机系统母板上的附加电路,通过计算机系统的PCI槽之一而利用IDE兼容磁盘驱动器。系统板上的PCI槽不加改变并且保持被其它PCI扩展槽完全PCI兼容。本发明还开发利用了在正常系统操作期间未被PCI规约所用的几个管脚。
带PCI联接器的IDE添加卡通过在PCI规约中未被分配使用的测试输入管脚上提供存在信号而发出表示其存在于PCI槽上的信号,来修正系统母板。计算机系统的母板将包括弱上拉电阻,以当不存在IDE卡时以确认信号为不工作的指示。当IDE卡插入后将在该管脚上提供有效低信号。当在PCI槽中测出IDE卡时,信号控制电路将启动以允许适当的中断以及其它将从卡上测出的和被利用的其他信号。
在修改后的系统母板上的受影响的PCI槽当IDE卡存在信号启动控制门时用来经PCI预留的管脚接收来自系统的软盘驱动接口的DSKCHG信号。IDE卡中断输出将通过另一被启动的门电路将适当的主硬盘驱动中断信号提供给系统的中断控制器。IDE中断的路由是经过在PCI规约中另一预留的和未用的管脚。与此类似。如果计算机系统具有挂在辅助I/O总线上的硬盘驱动器,其中断信号将加给中断控制器作为辅助硬盘驱动器中断。最后,另一PCI预留管脚在IDE卡插在PCI槽中时用于向硬盘驱动器工作指示LED信令启动信号。附图简短描述:
本发明的目的、特征和优点将从下面的描述中清楚获悉。
图1为计算机系统体系的方框图,它采用了本发明一个实施例的总线的分层结构;
图2示出一些分配来用作PCI兼容互连用的管脚;
图3是实现本发明一个实施例的PCI至IDE互连电路的门电平电路图。本发明的详细描述:
提供一种用来操作带PCI兼容扩展槽的计算机系统中的外添加卡的方法和装置,其中外添加卡需要某些在PCI规约下未用的控制信号。在此详述描述中,描述了一种包括PCI总线的PCI兼容扩展槽的计算机系统的一个实施例。该系统还包括参考ISA或EISA总线标准描述的辅助I/O总线。应当理解本实施例是用作说明而非用作限制,本发明也可以在其它的计算机系统上实施,而这种系统可以采用不适用于给定总线标准的添加卡。
该详细描述的各处,为了彻底理解本发明,陈述了诸如具体的信号名、总线规约和电阻值的各种具体细节。非常清楚,本发明所属技术领域的普通技术人员无须这些细节也可实施本发明。在其他场合下,为了避免混淆发明主题,已知的元件、结构和工艺未加详述。此外,在此详细描述中的信号名称并未打算表达给定信号的有效状态(有效高或有效低),而是简单地用于讨论时命名接口信号之用。
现在参见图1,示出本发明所采用的计算机系统的体系。图1的计算机系统体系突出了体系的分层结构的总线组织。可以见到计算机系统的CPU10经宿主总线20与其SRAM高速缓冲存储器15通讯。在一个实施例中,宿主总线20包括控制线21、地址线22和数据线23。在其它实施例中,地址和数据线可以复用,以共享信号通路。宿主总线通常用来满足与CPU10所实现的处理器类型相关的高计算特性的需要。
在一些计算机系统体系中,计算机系统的主存储器将直接耦合到处理器宿主总线上。在所示的实施例中,DRAM主存储器18经宿主/PCI总线桥25耦合到宿主总线上。宿主/PCI总线桥25用作宿主总线20与系统PCI总线30之间的桥接器。上面所描述的PCI总线用作主I/O总线,并满足日益增涨的标准化的局域总线的需求,该局域总线并不直接依赖于计算机系统的处理器总线的速度和规格。图1的PCI总线30以控制线31和地址/数据线32分别示出。宿主/PCI总线桥25监视宿主总线20和PCI总线31和32,并确定数据交换是否是分配给计算机系统的主存储器系统18或CPU请求向总线的分层结构的下层传播,再下一步轮到PCI总线30。
在图1中示出耦合到PCI总线30设计用来与PCI总线标准配合的外设的三个PCI槽36、37和38。这种添加卡可包括图形加速器、磁盘驱动控制器、以及其它具备PCI局域总线30的能力的速度敏感的外设。图中还示出在PCI总线与宿主总线的地址/数据线32之间的几个缓存器组,由LBX缓存器34代表,用于在两个总线20和30之间传输缓存数据。缓存器34用来补偿两个总线所工作的改变速度,并且通过允许在宿主总线20与PCI总线间的并行性提供较大总线通过量以及降低潜伏危机而提高和系统的特性。
最后在图1中还示出,以另一方案实施的辅助I/O总线40和可以为适用于ISA或EISA或其它外部总线标准的外部I/O总线。耦合到I/O总线40的是4个用于接纳各种外设的4个I/O槽41、42、43和44。主板上的外设45,诸如软盘驱动器,装有IDE标准互联装置的硬盘驱动器以及通常与计算机系统相联的其它外设,就设在系统母板上且不需要提供用于其它添加卡升级的I/O槽。主板外设45当作电存储器和辅助I/O总线40。总的说来,I/O总线40是比PCI总线30慢的总线但却仍包括在新计算机系统中以保持与先前设计的外设兼容。
在ISA总线和PCI总线使个人计算机平台建在作为主要I/O总线的PCI总线周围以调节大的ISA产品的基础。ISA总线提供24位寻址及16位数据通路。EISA I/O总线使个人计算机平台建在作为主要I/O总线的PCI总线周围以调节巨大的EISA/ISA产品基础。随着16位与8位ISA硬件和软件的兼容,EISA总线提供32位寻址和32位数据路由。当然,其他的辅助I/O总线也可提供类似的特征。
耦合在图1的计算机体系的PCI总线30与辅助I/O总线40之间的是总线桥35。总线桥35可采用将辅助I/O总线40与PCI总线30接口的逻辑以及采用对任何所需DMA控制器和中断控制逻辑的支持。例如,如果带有IDE互联装置的传统硬盘驱动器在I/O槽41中,且IDE驱动器请求与CPU交换数据,IDE驱动器将发出中断IQ14,它将被认作一个由系统所访问的主要硬盘驱动器。当计算机系统识别IRQ14的中断后,则将引导访问硬盘的所需码。当IDE硬盘驱动器有效时,将也输出一个用DACTIVE信号,用于点亮表示给用户硬盘有效的LED。最后,如上所述,当IDE磁盘驱动器在I/O总线40上有效时,数据交换的共享部分可由在其他I/O槽之一中或单独地联到I/O总线的软盘驱动控制器实现。软盘驱动接口提供数据交换所需的DSKCHG信号。
从上面可以看出,为了有效地利用具有IDE互联装置的硬盘驱动器,需要使IDE添加卡能向IRQ14提供中断信号,能从软盘驱动器接收DSKCHG信号,最好也能提供HDACTIVE信号,以点亮硬盘有效指示LED。
应急PCI局域总线标准在采用辅助I/O总线外还提供一个不同的I/O中断机构,因而可使计算机系统连续探索ISA和EISA设计的外设的现存产品基础。现在见图2,示出用于PCI配合装置的信号分配图。在装置侧边所标的标号的具体信号线表示实现PCI接口的一个实施例的管脚输出。除了提供地址和数据信号线之外,可以看到PCI接口提供四个中断,INTA#,INTB#,INTC#和INTD#。在PCI总线周围的系统母板上分配的每个PCI槽应包括这些中断线。可以发现没有象IDE添加卡所需的IRQ14中断信号那样的信号的特别分配。与此类似,没有来自软盘驱动器的输入到PCI槽中的IDE卡中的DSKCHG信号,也没有用DACTIVE输出管脚分配。因此,PCI规范中及其本身不能在PCI适配扩展槽中实现IDE添加卡。
本发明的一个重要方面在于提供一种机构用于在计算机系统的PCI槽中利用IDE适配添加卡,其中PCI槽是完全PCI适配并且通常与任何其它PCI添加卡一起工作。这一点是在计算机系统在正常运行时发现的,在PCI规范中某些管脚未被采用。图2示出一系列测试管脚的PCI标准分配,最好能与JTAG测试平台(IEEE规范1149.1)适配。在正常的系统操作中,测试管脚不应被采用,且在PCI规范下这些管脚保持无效。这些管脚之一被分配有TCK信号,它通常被当作一个时钟在测试工作期间输入到PCI适配装置上,PCI规范并不提供任何未用的管脚,而是如图2所示在某些实施方案中多个管脚被留作备用。这些包括管脚17表示的RSVD1、20表示的RSVD2和21表示的RSVD3。其他所包括的并未示出。
可以设计一种具有全PCI适配PCI扩展槽的计算机系统,同时还具有几个利用实现在PCI槽之一中的IDE添加卡的管脚的优点。如果正确实行的话,受影响的PCI槽仍将与任何PCI适配添加卡正常工作,并也将提供支持用以在PCI总线上采用适合构成的IDE添加卡。IDE卡仍将被分配有所见到的PCI地址/数据传输规约。
现在见图3,示出一个电路的门电平电路图,它可使计算机系统母板与PCI联接器槽中的IDE添加卡一起工作。图3示出一个PCI联接器50,用于接纳PCI适配装置,或装有可管脚兼容的PCI联接器的IDE添加卡。可管脚兼容的联接器将IDE地址和数据输出信号送到PCI特定的地址和数据线上。IDE装备联接器也将具备上述管脚的优点,它通常是被PCI装置所采用的。
在PCI槽中IDE装置的识别是在母板上的所示的电路基础上由计算机系统执行的。IDE添加卡的存在是通过管脚4由上述的通常为PCI规范的TCK时钟信号的正常输入的有效信号表示的,换言之,该信号也可联到I/O端口上,使CPU读出来确定是否存在适当构成的IDE添加卡。系统母板将装备上拉电阻52,这样当没有IDE卡时,在节点53上将可见到无效的TTL-高信号。在所示的实施例中,建议用6.8KΩ的小电阻值用作很弱的上拉,这可克服使其它器件利用此管脚。IDE互联将开发三个预留的上述管脚,经管脚17的RSVD1输出、经管脚20的RSVD2输出以及经管脚21的作为输入的RSVD3。在系统母板上的上拉电阻54和55当在PCI联接器50中没有IDE装置时保持PCI适配。
当PCI联接器中无IDE装置时,在辅助I/O总线上的板上硬盘驱动器将输出IRQ14的中断信号,它被计算机系统的BIOS当作主要硬盘驱动器中断。中断经门60和开放集电极61传播,这样可得到正常硬盘驱动中断。当在PCI联接器50中提供IDE添加卡时,经过管脚17驱动其中断输出。PCI联接器50中IDE添加卡的存在也将通过输出管脚4发出有效低信号,它将经过反相器62传播的门60的使能输入端。这使得板上硬盘驱动IRQ14通过该门。来自IDE卡的中断输出经过管脚17经门65传出,该门接收因存在经管脚4传出的信号的使能信号。IDE中断通过开放的集电极61并作为IRQ14硬盘驱动中断的输出。与此类似,当在PCI联接器中有IDE添加卡时,存在信号将启动门67以经RSVD3管脚21接收DSKCHG信号,该信号由于上述原因是需要的。
当IDE添加卡加到PCI联接器50时,计算机系统可以包括在系统辅助I/O总线40上的硬盘驱动器。在此情况下,需要处理由硬盘驱动器产生的中断。当PCI联接器50启动存在信号时,使能信号被提供给门70,它使第二硬盘驱动中断输出经过开放集电极71,并将信号作为IRQ15提供给系统的中断控制器,该信号被当作第二硬盘驱动器中断。该部分电路也装有上拉电阻73,这样,当联接器50中没有IDE卡时,IRQ15上将没有伪信号。最后,当IDE卡在时,非常方便地使用RSVD2信号通过输出管脚20提供HDACTIVIE信号。该信号是经开放集电极75传出的,以向计算机系统的硬盘驱动器有效指示LED提供HDACTIVE信号。该开放集电极75可另外以由TCK信号控制的(虚线所示)三态门来实现的。
从上面可见,当通常适配的PCI卡加到PCI联接器50中时,PCI联接将仍由PCI规范限定而不加修改。仅当PCI联接器50中采用IDE添加卡时,本发明的操作才出现。在另一实施例中,其它所用的管脚也可代替上述管脚。此外,还可用其它阻值的电阻当作上拉电阻。当然,在其它实施方案中,低和高信号可相互交换。
Claims (17)
1.一种计算机系统,包括:
中央处理单元(CPU);
耦合在CPU上的宿主总线,用于向CPU和从CPU上传输信号;
与第一总线标准适配的主I/O总线,用于在计算机系统与外设之间提供通信路径;
耦合在宿主总线与主I/O总线之间的总线桥路,用于在总线之间进行数据交换;
耦合到主I/O总线的总线联接器,用于将外设联到主I/O总线上;以及
耦合在总线联接器上的电路,允许外设在所述总线联接器中得到使用,而其中外设所需的信令能力却未由所述第一总线标准提供。
2.如权利要求1的计算机系统,其中所述第一总线标准为外部设备互联(PCI)总线标准,而外设为采用综合驱动电子装置(IDE)接口的硬盘。
3.如权利要求2的计算机系统,其中总线联接器包括多个管脚输出,计算机系统还包括:
耦合到第一总线联接器管脚输出的存在信号线,其中第一总线联接器管脚输出是在根据PCI总线标准正常计算机系统操作期间未被使用的管脚输出;
耦合到第二总线连接器管脚的IDE中断信号线,其中第二总线联接器管脚输出是在根据PCI总线标准正常计算机系统操作期间未被使用的管脚输出;以及
耦合到IDE中断信号线并响应于存在信号线的第一控制门,用来控制在所述IDE中断信号线上作为系统的主硬盘驱动中断的IDE中断信号。
4.如权利要求3的计算机系统,还包括:
软盘驱动控制器,用于提供DSKCHG输出信号;
耦合到第三总线联接器管脚输出的DSKCHG信号接收线,其中第三总线联接器管脚输出是在根据PCI总线标准正常计算机系统操作期间未被使用的管脚输出;以及
耦合在DSKCHG输出信号与DSKCHG信号接收线之间的第二控制门,第二控制门响应于存在信号线用来控制给第三总线联接器管脚输出的DSKCHG信号。
5.如权利要求4的计算机系统,还包括:
硬盘驱动器有效指示灯;以及
耦合到第四总线联接器管脚输出和所述硬盘驱动器有效指示灯的硬盘驱动器有效信号线,当外设启动后,用于提供一个信号来启动硬盘驱动器有效指示灯,第四总线联接器管脚输出是在根据PCI总线标准在正常计算机系统操作期间未被使用的管脚输出。
6.如权利要求4的计算机系统,还包括响应于存在信号线的第三控制门,当硬盘驱动中断的源未从总线联接器耦合到主I/O总线时,该第三控制门用来防止作为主硬盘驱动器中断的硬盘驱动中断加到计算机系统。
7.如权利要求6的计算机系统,还包括响应于存在信号线的第四控制门,用来控制作为计算机系统的辅助硬盘驱动器中断的硬盘驱动器中断信号不从总线联接器耦合到主I/O总线。
8.如权利要求9的计算机系统,还包括:
耦合到第三控制门输出的第一开放集电极;以及
耦合到第四控制门的输出的第二开放集电极,
其中第一和第二开放集电极允许共享计算机系统的主和辅硬盘驱动器中断。
9.如权利要求8的计算机系统,还包括:
耦合到存在信号线的第一上拉电阻;
耦合到硬盘驱动有效信号线的第二上拉电阻;
耦合到IDE中断信号线的第三上拉电阻。
10.如权利要求9的计算机系统,还包括:
耦合到所述第四控制门的输出的第四上拉电阻。
11.如权利要求2的计算机系统,其中总线联接器是完全适配的,以接纳PCI适配的添加卡。
12.如权利要求3的计算机系统,其中第一总线联接器管脚输出包括根据PCI总线标准分配为TCK输入的管脚。
13.如权利要求5的计算机系统,其中第三和第四总线联接器管脚输出包括根据PCI总线标准的备用管脚。
14.一种在PCI适配扩展槽中利用带IDE接口的硬盘驱动器的方法,包括步骤为:
通过在添加卡的第一输出上提供有效信号而发出IDE添加卡在PCI适配槽中的命令;
控制来自IDE添加卡的第二输出的IDE中断通过使能门而控制计算机系统的主硬盘驱动中断;
当IDE卡启动时,从IDE添加卡的第三输出中产生有效信号给计算机系统的磁盘驱动器有效指示灯;
控制给PCI适配槽的软盘驱动控制器DSKCHG信号。
15.如权利要求14的方法,还包括控制给计算机系统的第二硬盘驱动器中断的来自非PCI槽的硬盘驱动中断。
16.如权利要求15的方法,还包括轻微上拉第一、第二和第三PCI槽的输出。
17.如权利要求14的方法,其中第一输出耦合到按PCI总线标准分配为TCK输入的联接器管脚。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
US25536594A | 1994-06-08 | 1994-06-08 | |
US08/255,365 | 1994-06-08 |
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Publication Number | Publication Date |
---|---|
CN1152965A true CN1152965A (zh) | 1997-06-25 |
CN1084006C CN1084006C (zh) | 2002-05-01 |
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ID=22967988
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Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
CN95193404A Expired - Fee Related CN1084006C (zh) | 1994-06-08 | 1995-06-05 | 允许在pci标准总线上使用非pci标准源的计算机系统接口 |
Country Status (10)
Country | Link |
---|---|
US (1) | US5768612A (zh) |
KR (1) | KR100366859B1 (zh) |
CN (1) | CN1084006C (zh) |
AU (1) | AU2662895A (zh) |
BR (1) | BR9507958A (zh) |
DE (1) | DE19580606C2 (zh) |
GB (1) | GB2303476B (zh) |
HK (1) | HK1014072A1 (zh) |
MX (1) | MX9606018A (zh) |
WO (1) | WO1995034065A2 (zh) |
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- 1995-06-05 GB GB9625744A patent/GB2303476B/en not_active Expired - Fee Related
- 1995-06-05 AU AU26628/95A patent/AU2662895A/en not_active Abandoned
- 1995-06-05 DE DE19580606T patent/DE19580606C2/de not_active Expired - Fee Related
- 1995-06-05 BR BR9507958A patent/BR9507958A/pt not_active IP Right Cessation
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
C06 | Publication | ||
PB01 | Publication | ||
C10 | Entry into substantive examination | ||
SE01 | Entry into force of request for substantive examination | ||
C14 | Grant of patent or utility model | ||
GR01 | Patent grant | ||
C17 | Cessation of patent right | ||
CF01 | Termination of patent right due to non-payment of annual fee |
Granted publication date: 20020501 Termination date: 20100605 |